vcdvcd 1.0.5

=VCDVCD
：idPrefix:
：idSeparator:-
：SectAnchors:
：SectLink:
：SectNumLevels:6
：SectNums:
：TOC:宏
：TOCLevels:6
：TOC标题：

python verilog value change dump（VCD）解析器库+nifty<；<；VCDCAT>；VCD命令行查看器。

TOC:：[]

==安装


安装最新版本：

….
python-m pip安装--用户VCDVCD
….


直接从此存储库安装master：

….
python-m pip安装--可编辑。--用户
…


使用<；<；VCDCAT>；直接从这个回购协议上直接从这个回购协议上直接安装而不安装：

…
./VCDCAT-h
…
>

==VCDCAT


/>
VCD-h

niffty-terminal-clip-VCD-VCD-VCD-viewer：

>
/>./VCDCAT-h
/>/>
/>

/>VCDCAT-VCD-VCD-VCD-VCD-VCD-VCD-h
/>/><
/>/>
/>/>输出：
..
0时间
1计数器时钟
2counter_tb.enable
3 counter_tb.out[1:0]
4 counter_tb.reset
5 counter_tb.top.out[1:0]

0 1 2 3 4 5
===========
0 1 0 x 0 x
1 0 0 x 1 x
2 1 0 0 1 0
3 0 0 0 0 0
4 1 0 0 0 0
5 0 1 0 0 0
6 1 1 1 0 1
7 0 1 1 0 1
8 1 1 2 0 2
9 0 1 2 0 2
10 1 1 3 0 3
11 0 1 3 0 3
12 1 1 0 0 0<0<0<0 0<0 0<0 0 0<0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<<0 0 0 0 0 0 0 0 0 0 0 0 0 0<<<<<<<<<<<<<<<<<<<<<<<<<<<<0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0信号：

……
./VCDCAT计数器_tb.VCD顶部。启用重置顶部。重置
….



输出：

….

0时间
1个计数器顶部。启用
2个计数器顶部顶部。重置



<0 1 2
<0 0 0
<0 0 0 0 0
1 0 1
>3 0 0 0 0
5 1 0
>0 0 0



















<0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0只转储每个时间：

。
。
。
。
。
。
。
。
。
。
。
。
。
。
。
。
0 x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x x复位
2 0计数器输出[1:0]
2 0计数器输出[1:0]
2 1计数器。时钟
3 0计数器。时钟
3 0计数器。重置
4 1计数器。时钟
5 0计数器。时钟
5 1计数器。启用
6 1计数器。输出[1:0]
6 1计数器。输出[1:0]
6 1计数器。输出[1:0]
6 1计数器。输出[1:0]
6 1计数器。时钟
7 0计数器。时钟

8 2计数器。输出[1:0]
8 2计数器。时钟
7 0计数器。时钟
7 0计数器。时钟
8 0计数器。时钟
8 2计数器。_tb.top.out[1:0]
8 1计数器_tb.clock
9 0计数器时钟
10 3计数器输出[1:0]
10 3计数器输出[1:0]
10 3计数器输出[1:0]
10 1计数器输出时钟
11 0计数器输出时钟
12 0计数器输出[1:0]
12 0计数器输出[1:0]
12 0计数器输出[1:0]
12 1计数器输出[1:0]
12 1计数器输出时钟
13 0计数器输出时钟
14 0计数器输出[1:0]
14 1计数器输出[1:0]
14 1计数器输出计数器输出[1:0]
14 1计数器输出计数器输出[1:0]<_tb.top.out[1:0]
14 1计数器_tb.clock
15 0计数器时钟
16 2计数器输出[1:0]
16 2计数器输出[1:0]
16 1计数器时钟
17 0计数器时钟
18 3计数器输出[1:0]
18 3计数器输出[1:0]
18 3计数器输出[1:0]
18 3计数器输出[1:0]
18 1计数器时钟
18 1计数器输出[1:0]
18 1计数器时钟
19 0计数器输出[1:0]
19 0计数器输出[1:0]
20 0计数器输出[1:0]
20 0计数器输出[1:0]
20 0计数器输出[1:0]
20 0计数器时钟
_tb.top.out[1:0]
20 1计数器_tb.clock
21 0计数器时钟
22 1计数器输出[1:0]
22 1计数器输出[1:0]
22 1计数器输出[1:0]
22 1计数器输出[1:0]
22 1计数器时钟
23 0计数器时钟
24 2计数器输出[1:0]
24 2计数器输出[1:0]
24 1计数器输出[1:0]
24 1计数器时钟
25 0计数器时钟
25 0计数器输出[1:0]
24 1计数器时钟
25 0计数器输出[1:0计数器时钟
25 0计数器时钟
25 0计数器输出。启用
26 1计数器时钟
26 1计数器输出计数器时钟
26关于这个repository

VCD格式由verilog标准定义，可以用`$dumpvars`生成。

一次解析整个VCD。有关流的实现，请参见：link:https://github.com/gordonmcgregor/vcd_parser[]。

派生自sameer gauria的版本，该版本当前仅托管在带有电子邮件修补程序且没有公共错误跟踪的pypi上：link:https://pypi.python.org/pypi/verilog_vcd[]。还有一个只读镜像：link:https://github.com/zylin/verilog/verilog-vcd[].


library用法示例：


..
br/>./examples.py
….

==release procedure


创建一个标签并推送它：

/>….
/>git tag-a v1.0.1-m v1.0.1
git push——git push——follow tags
<
/>

/>


中的“version”字段` setup.py`:

….
vim setup.py
….



….
python-m pip install--用户设置工具车轮捆绳
python setup.py sdist bdist_wheel
捆绳上传距离/*
rm-rf build dist*.egg info

标签：

• 命令行
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• 计数器
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